Lucas S Heusler Heusler Transistor Sizing for Timing Optimization of Combinational Digital CMOS Circuits

Transistor Sizing for Timing Optimization of Combinational Digital CMOS Circuits

von Lucas S Heusler

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Beschreibung

Autor*in

Lucas S Heusler

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Details

ISBN: 9783891913307
Verlag: Hartung-Gorre
Erscheinung: 1990

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